EFM32 Gecko Software Documentation  efm32g-doc-5.1.2
Data Structures | Macros
efm32g_cmu.h File Reference

Detailed Description

EFM32G_CMU register and bit field definitions.

Version
5.1.2

License

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Definition in file efm32g_cmu.h.

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Data Structures

struct  CMU_TypeDef
 

Macros

#define _CMU_AUXHFRCOCTRL_MASK   0x000000FFUL
 
#define _CMU_AUXHFRCOCTRL_RESETVALUE   0x00000080UL
 
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#define _CMU_CALCNT_CALCNT_SHIFT   0
 
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#define _CMU_CMD_HFCLKSEL_HFRCO   0x00000001UL
 
#define _CMU_CMD_HFCLKSEL_HFXO   0x00000002UL
 
#define _CMU_CMD_HFCLKSEL_LFRCO   0x00000003UL
 
#define _CMU_CMD_HFCLKSEL_LFXO   0x00000004UL
 
#define _CMU_CMD_HFCLKSEL_MASK   0x7UL
 
#define _CMU_CMD_HFCLKSEL_SHIFT   0
 
#define _CMU_CMD_MASK   0x0000000FUL
 
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#define _CMU_CTRL_CLKOUTSEL0_HFCLK16   0x00000005UL
 
#define _CMU_CTRL_CLKOUTSEL0_HFCLK2   0x00000002UL
 
#define _CMU_CTRL_CLKOUTSEL0_HFCLK4   0x00000003UL
 
#define _CMU_CTRL_CLKOUTSEL0_HFCLK8   0x00000004UL
 
#define _CMU_CTRL_CLKOUTSEL0_HFRCO   0x00000000UL
 
#define _CMU_CTRL_CLKOUTSEL0_HFXO   0x00000001UL
 
#define _CMU_CTRL_CLKOUTSEL0_MASK   0x700000UL
 
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#define _CMU_CTRL_CLKOUTSEL1_LFXO   0x00000001UL
 
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#define _CMU_CTRL_HFXOBOOST_80PCENT   0x00000002UL
 
#define _CMU_CTRL_HFXOBOOST_DEFAULT   0x00000003UL
 
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#define _CMU_CTRL_HFXOGLITCHDETEN_MASK   0x80UL
 
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#define _CMU_CTRL_HFXOMODE_BUFEXTCLK   0x00000001UL
 
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#define _CMU_CTRL_HFXOTIMEOUT_8CYCLES   0x00000000UL
 
#define _CMU_CTRL_HFXOTIMEOUT_DEFAULT   0x00000003UL
 
#define _CMU_CTRL_HFXOTIMEOUT_MASK   0x600UL
 
#define _CMU_CTRL_HFXOTIMEOUT_SHIFT   9
 
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#define _CMU_CTRL_LFXOBOOST_70PCENT   0x00000000UL
 
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#define _CMU_CTRL_LFXOMODE_XTAL   0x00000000UL
 
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#define _CMU_CTRL_LFXOTIMEOUT_DEFAULT   0x00000003UL
 
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#define _CMU_FREEZE_REGFREEZE_MASK   0x1UL
 
#define _CMU_FREEZE_REGFREEZE_SHIFT   0
 
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#define _CMU_HFCORECLKEN0_AES_SHIFT   0
 
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#define _CMU_HFCORECLKEN0_RESETVALUE   0x00000000UL
 
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#define _CMU_HFPERCLKDIV_HFPERCLKDIV_HFCLK512   0x00000009UL
 
#define _CMU_HFPERCLKDIV_HFPERCLKDIV_HFCLK64   0x00000006UL
 
#define _CMU_HFPERCLKDIV_HFPERCLKDIV_HFCLK8   0x00000003UL
 
#define _CMU_HFPERCLKDIV_HFPERCLKDIV_MASK   0xFUL
 
#define _CMU_HFPERCLKDIV_HFPERCLKDIV_SHIFT   0
 
#define _CMU_HFPERCLKDIV_HFPERCLKEN_DEFAULT   0x00000001UL
 
#define _CMU_HFPERCLKDIV_HFPERCLKEN_MASK   0x100UL
 
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#define _CMU_HFPERCLKEN0_ACMP0_SHIFT   7
 
#define _CMU_HFPERCLKEN0_ACMP1_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_ACMP1_MASK   0x100UL
 
#define _CMU_HFPERCLKEN0_ACMP1_SHIFT   8
 
#define _CMU_HFPERCLKEN0_ADC0_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_ADC0_MASK   0x4000UL
 
#define _CMU_HFPERCLKEN0_ADC0_SHIFT   14
 
#define _CMU_HFPERCLKEN0_DAC0_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_DAC0_MASK   0x800UL
 
#define _CMU_HFPERCLKEN0_DAC0_SHIFT   11
 
#define _CMU_HFPERCLKEN0_GPIO_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_GPIO_MASK   0x1000UL
 
#define _CMU_HFPERCLKEN0_GPIO_SHIFT   12
 
#define _CMU_HFPERCLKEN0_I2C0_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_I2C0_MASK   0x8000UL
 
#define _CMU_HFPERCLKEN0_I2C0_SHIFT   15
 
#define _CMU_HFPERCLKEN0_MASK   0x0000FDFFUL
 
#define _CMU_HFPERCLKEN0_PRS_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_PRS_MASK   0x400UL
 
#define _CMU_HFPERCLKEN0_PRS_SHIFT   10
 
#define _CMU_HFPERCLKEN0_RESETVALUE   0x00000000UL
 
#define _CMU_HFPERCLKEN0_TIMER0_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_TIMER0_MASK   0x10UL
 
#define _CMU_HFPERCLKEN0_TIMER0_SHIFT   4
 
#define _CMU_HFPERCLKEN0_TIMER1_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_TIMER1_MASK   0x20UL
 
#define _CMU_HFPERCLKEN0_TIMER1_SHIFT   5
 
#define _CMU_HFPERCLKEN0_TIMER2_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_TIMER2_MASK   0x40UL
 
#define _CMU_HFPERCLKEN0_TIMER2_SHIFT   6
 
#define _CMU_HFPERCLKEN0_UART0_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_UART0_MASK   0x8UL
 
#define _CMU_HFPERCLKEN0_UART0_SHIFT   3
 
#define _CMU_HFPERCLKEN0_USART0_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_USART0_MASK   0x1UL
 
#define _CMU_HFPERCLKEN0_USART0_SHIFT   0
 
#define _CMU_HFPERCLKEN0_USART1_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_USART1_MASK   0x2UL
 
#define _CMU_HFPERCLKEN0_USART1_SHIFT   1
 
#define _CMU_HFPERCLKEN0_USART2_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_USART2_MASK   0x4UL
 
#define _CMU_HFPERCLKEN0_USART2_SHIFT   2
 
#define _CMU_HFPERCLKEN0_VCMP_DEFAULT   0x00000000UL
 
#define _CMU_HFPERCLKEN0_VCMP_MASK   0x2000UL
 
#define _CMU_HFPERCLKEN0_VCMP_SHIFT   13
 
#define _CMU_HFRCOCTRL_BAND_11MHZ   0x00000002UL
 
#define _CMU_HFRCOCTRL_BAND_14MHZ   0x00000003UL
 
#define _CMU_HFRCOCTRL_BAND_1MHZ   0x00000000UL
 
#define _CMU_HFRCOCTRL_BAND_21MHZ   0x00000004UL
 
#define _CMU_HFRCOCTRL_BAND_28MHZ   0x00000005UL
 
#define _CMU_HFRCOCTRL_BAND_7MHZ   0x00000001UL
 
#define _CMU_HFRCOCTRL_BAND_DEFAULT   0x00000003UL
 
#define _CMU_HFRCOCTRL_BAND_MASK   0x700UL
 
#define _CMU_HFRCOCTRL_BAND_SHIFT   8
 
#define _CMU_HFRCOCTRL_MASK   0x0001F7FFUL
 
#define _CMU_HFRCOCTRL_RESETVALUE   0x00000380UL
 
#define _CMU_HFRCOCTRL_SUDELAY_DEFAULT   0x00000000UL
 
#define _CMU_HFRCOCTRL_SUDELAY_MASK   0x1F000UL
 
#define _CMU_HFRCOCTRL_SUDELAY_SHIFT   12
 
#define _CMU_HFRCOCTRL_TUNING_DEFAULT   0x00000080UL
 
#define _CMU_HFRCOCTRL_TUNING_MASK   0xFFUL
 
#define _CMU_HFRCOCTRL_TUNING_SHIFT   0
 
#define _CMU_IEN_AUXHFRCORDY_DEFAULT   0x00000000UL
 
#define _CMU_IEN_AUXHFRCORDY_MASK   0x10UL
 
#define _CMU_IEN_AUXHFRCORDY_SHIFT   4
 
#define _CMU_IEN_CALRDY_DEFAULT   0x00000000UL
 
#define _CMU_IEN_CALRDY_MASK   0x20UL
 
#define _CMU_IEN_CALRDY_SHIFT   5
 
#define _CMU_IEN_HFRCORDY_DEFAULT   0x00000000UL
 
#define _CMU_IEN_HFRCORDY_MASK   0x1UL
 
#define _CMU_IEN_HFRCORDY_SHIFT   0
 
#define _CMU_IEN_HFXORDY_DEFAULT   0x00000000UL
 
#define _CMU_IEN_HFXORDY_MASK   0x2UL
 
#define _CMU_IEN_HFXORDY_SHIFT   1
 
#define _CMU_IEN_LFRCORDY_DEFAULT   0x00000000UL
 
#define _CMU_IEN_LFRCORDY_MASK   0x4UL
 
#define _CMU_IEN_LFRCORDY_SHIFT   2
 
#define _CMU_IEN_LFXORDY_DEFAULT   0x00000000UL
 
#define _CMU_IEN_LFXORDY_MASK   0x8UL
 
#define _CMU_IEN_LFXORDY_SHIFT   3
 
#define _CMU_IEN_MASK   0x0000003FUL
 
#define _CMU_IEN_RESETVALUE   0x00000000UL
 
#define _CMU_IF_AUXHFRCORDY_DEFAULT   0x00000000UL
 
#define _CMU_IF_AUXHFRCORDY_MASK   0x10UL
 
#define _CMU_IF_AUXHFRCORDY_SHIFT   4
 
#define _CMU_IF_CALRDY_DEFAULT   0x00000000UL
 
#define _CMU_IF_CALRDY_MASK   0x20UL
 
#define _CMU_IF_CALRDY_SHIFT   5
 
#define _CMU_IF_HFRCORDY_DEFAULT   0x00000001UL
 
#define _CMU_IF_HFRCORDY_MASK   0x1UL
 
#define _CMU_IF_HFRCORDY_SHIFT   0
 
#define _CMU_IF_HFXORDY_DEFAULT   0x00000000UL
 
#define _CMU_IF_HFXORDY_MASK   0x2UL
 
#define _CMU_IF_HFXORDY_SHIFT   1
 
#define _CMU_IF_LFRCORDY_DEFAULT   0x00000000UL
 
#define _CMU_IF_LFRCORDY_MASK   0x4UL
 
#define _CMU_IF_LFRCORDY_SHIFT   2
 
#define _CMU_IF_LFXORDY_DEFAULT   0x00000000UL
 
#define _CMU_IF_LFXORDY_MASK   0x8UL
 
#define _CMU_IF_LFXORDY_SHIFT   3
 
#define _CMU_IF_MASK   0x0000003FUL
 
#define _CMU_IF_RESETVALUE   0x00000001UL
 
#define _CMU_IFC_AUXHFRCORDY_DEFAULT   0x00000000UL
 
#define _CMU_IFC_AUXHFRCORDY_MASK   0x10UL
 
#define _CMU_IFC_AUXHFRCORDY_SHIFT   4
 
#define _CMU_IFC_CALRDY_DEFAULT   0x00000000UL
 
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#define CMU_HFPERCLKEN0_VCMP_DEFAULT   (_CMU_HFPERCLKEN0_VCMP_DEFAULT << 13)
 
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#define CMU_HFRCOCTRL_BAND_14MHZ   (_CMU_HFRCOCTRL_BAND_14MHZ << 8)
 
#define CMU_HFRCOCTRL_BAND_1MHZ   (_CMU_HFRCOCTRL_BAND_1MHZ << 8)
 
#define CMU_HFRCOCTRL_BAND_21MHZ   (_CMU_HFRCOCTRL_BAND_21MHZ << 8)
 
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#define CMU_HFRCOCTRL_SUDELAY_DEFAULT   (_CMU_HFRCOCTRL_SUDELAY_DEFAULT << 12)
 
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#define CMU_IEN_CALRDY_DEFAULT   (_CMU_IEN_CALRDY_DEFAULT << 5)
 
#define CMU_IEN_HFRCORDY   (0x1UL << 0)
 
#define CMU_IEN_HFRCORDY_DEFAULT   (_CMU_IEN_HFRCORDY_DEFAULT << 0)
 
#define CMU_IEN_HFXORDY   (0x1UL << 1)
 
#define CMU_IEN_HFXORDY_DEFAULT   (_CMU_IEN_HFXORDY_DEFAULT << 1)
 
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#define CMU_IEN_LFXORDY   (0x1UL << 3)
 
#define CMU_IEN_LFXORDY_DEFAULT   (_CMU_IEN_LFXORDY_DEFAULT << 3)
 
#define CMU_IF_AUXHFRCORDY   (0x1UL << 4)
 
#define CMU_IF_AUXHFRCORDY_DEFAULT   (_CMU_IF_AUXHFRCORDY_DEFAULT << 4)
 
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#define CMU_IF_CALRDY_DEFAULT   (_CMU_IF_CALRDY_DEFAULT << 5)
 
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#define CMU_IFC_CALRDY_DEFAULT   (_CMU_IFC_CALRDY_DEFAULT << 5)
 
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#define CMU_IFC_HFXORDY_DEFAULT   (_CMU_IFC_HFXORDY_DEFAULT << 1)
 
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#define CMU_IFC_LFRCORDY_DEFAULT   (_CMU_IFC_LFRCORDY_DEFAULT << 2)
 
#define CMU_IFC_LFXORDY   (0x1UL << 3)
 
#define CMU_IFC_LFXORDY_DEFAULT   (_CMU_IFC_LFXORDY_DEFAULT << 3)
 
#define CMU_IFS_AUXHFRCORDY   (0x1UL << 4)
 
#define CMU_IFS_AUXHFRCORDY_DEFAULT   (_CMU_IFS_AUXHFRCORDY_DEFAULT << 4)
 
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#define CMU_IFS_CALRDY_DEFAULT   (_CMU_IFS_CALRDY_DEFAULT << 5)
 
#define CMU_IFS_HFRCORDY   (0x1UL << 0)
 
#define CMU_IFS_HFRCORDY_DEFAULT   (_CMU_IFS_HFRCORDY_DEFAULT << 0)
 
#define CMU_IFS_HFXORDY   (0x1UL << 1)
 
#define CMU_IFS_HFXORDY_DEFAULT   (_CMU_IFS_HFXORDY_DEFAULT << 1)
 
#define CMU_IFS_LFRCORDY   (0x1UL << 2)
 
#define CMU_IFS_LFRCORDY_DEFAULT   (_CMU_IFS_LFRCORDY_DEFAULT << 2)
 
#define CMU_IFS_LFXORDY   (0x1UL << 3)
 
#define CMU_IFS_LFXORDY_DEFAULT   (_CMU_IFS_LFXORDY_DEFAULT << 3)
 
#define CMU_LCDCTRL_FDIV_DEFAULT   (_CMU_LCDCTRL_FDIV_DEFAULT << 0)
 
#define CMU_LCDCTRL_VBFDIV_DEFAULT   (_CMU_LCDCTRL_VBFDIV_DEFAULT << 4)
 
#define CMU_LCDCTRL_VBFDIV_DIV1   (_CMU_LCDCTRL_VBFDIV_DIV1 << 4)
 
#define CMU_LCDCTRL_VBFDIV_DIV128   (_CMU_LCDCTRL_VBFDIV_DIV128 << 4)
 
#define CMU_LCDCTRL_VBFDIV_DIV16   (_CMU_LCDCTRL_VBFDIV_DIV16 << 4)
 
#define CMU_LCDCTRL_VBFDIV_DIV2   (_CMU_LCDCTRL_VBFDIV_DIV2 << 4)
 
#define CMU_LCDCTRL_VBFDIV_DIV32   (_CMU_LCDCTRL_VBFDIV_DIV32 << 4)
 
#define CMU_LCDCTRL_VBFDIV_DIV4   (_CMU_LCDCTRL_VBFDIV_DIV4 << 4)
 
#define CMU_LCDCTRL_VBFDIV_DIV64   (_CMU_LCDCTRL_VBFDIV_DIV64 << 4)
 
#define CMU_LCDCTRL_VBFDIV_DIV8   (_CMU_LCDCTRL_VBFDIV_DIV8 << 4)
 
#define CMU_LCDCTRL_VBOOSTEN   (0x1UL << 3)
 
#define CMU_LCDCTRL_VBOOSTEN_DEFAULT   (_CMU_LCDCTRL_VBOOSTEN_DEFAULT << 3)
 
#define CMU_LFACLKEN0_LCD   (0x1UL << 2)
 
#define CMU_LFACLKEN0_LCD_DEFAULT   (_CMU_LFACLKEN0_LCD_DEFAULT << 2)
 
#define CMU_LFACLKEN0_LETIMER0   (0x1UL << 1)
 
#define CMU_LFACLKEN0_LETIMER0_DEFAULT   (_CMU_LFACLKEN0_LETIMER0_DEFAULT << 1)
 
#define CMU_LFACLKEN0_RTC   (0x1UL << 0)
 
#define CMU_LFACLKEN0_RTC_DEFAULT   (_CMU_LFACLKEN0_RTC_DEFAULT << 0)
 
#define CMU_LFAPRESC0_LCD_DIV128   (_CMU_LFAPRESC0_LCD_DIV128 << 8)
 
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